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MICROPROCESADORES AMD VERSUS MICROPROCESADORES INTEL

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HARDWARE - MICROPROCESADORES INTEL CORE 2 EXTREME DE CUATRO NUCLEOS



FOTOS INTEL CORE 2 EXTREME


DE CUATRO NUCLEOS








El Procesador Intel® Core™2 Extreme de Cuatro Núcleos es el primer procesador de su clase para equipos de sobremesa y ofrece la tecnología más avanzada para procesadores. Este procesador se ha diseñado para los entusiastas de la informática.

Las actuales aplicaciones multimedia, como la edición y reproducción de vídeo/audio y la creación de modelos en 3D, aprovechan la informática de múltiples subprocesos para ofrecer alto rendimiento y demuestran una extraordinaria escalabilidad con los procesadores de cuatro núcleos. El procesador Intel Core 2 Extreme de Cuatro Núcleos puede realizar varias tareas al mismo tiempo con una mejora significativa en cuanto a la capacidad de respuesta del sistema, al descargar determinadas tareas en núcleos específicos con el fin de liberar recursos adicionales del procesador para otras tareas y permitir que los clientes hagan más en menos tiempo.
El Chipset Intel® 975X Express es compatible con el procesador Intel Core 2 Extreme de Cuatro Núcleos. Esta combinación de procesador y chipset ofrece una serie de posibilidades apasionantes, como gráficos duales, y proporciona un impresionante nivel de rendimiento para los usuarios exigentes.
Características del procesador Intel® Core™2 Extreme de cuatro núcleos
Características
Ventajas
Procesamiento de cuatro núcleos
Proporciona cuatro núcleos independientes en un mismo encapsulado con 8 MB de caché L2 y un bus del sistema a 1.066 MHz. Cuatro subprocesos físicos dedicados contribuyen a que los sistemas operativos y aplicaciones ofrezcan un rendimiento adicional, para que los usuarios finales puedan disfrutar de una capacidad mejorada de multitarea y de subprocesos múltiples con cualquier tipo de aplicación y carga de trabajo.
Ejecución dinámica ampliada Intel®
Mejora la velocidad y la eficacia de ejecución, al proporcionar más instrucciones por ciclo de reloj. Cada núcleo puede completar hasta cuatro instrucciones completas a la vez.
Acceso Intel® a memoria inteligente
Optimiza el uso del ancho de banda de datos desde el subsistema de memoria para acelerar la ejecución no secuencial. Un mecanismo de predicción de nuevo diseño reduce el tiempo que las instrucciones tienen que esperar hasta recibir los datos. Los nuevos algoritmos de búsqueda previa transfieren los datos desde la memoria del sistema a la rápida caché L2 antes de su ejecución. Estas funciones mantienen la canalización llena para mejorar la capacidad de procesamiento y el rendimiento.
Caché Intel® inteligente avanzada1
Asigna de forma dinámica la caché L2 compartida a cada núcleo del procesador en función de la carga de trabajo. Esta implementación eficaz y optimizada del doble núcleo aumenta la probabilidad de que cada núcleo pueda tener acceso a los datos guardados en la rápida caché L2, reduciendo significativamente la latencia al acceder a los datos que se utilizan con frecuencia y mejorando el rendimiento.
Intel® Advanced Digital Media Boost
Acelera la ejecución de las instrucciones Streaming SIMD Extension (SSE) para mejorar significativamente el rendimiento al utilizar una amplia gama de aplicaciones, como vídeo, audio, procesamiento de imágenes y fotografías, multimedia, codificación, financieras, de ingeniería y científicas. Las instrucciones SSE de 128 bits se emiten ahora a una velocidad de una por ciclo de reloj, multiplicando de hecho por dos la velocidad de ejecución con respecto a los procesadores de la generación anterior.
Tecnología Intel® de virtualización (Intel® VT)2
Con esta tecnología, una única plataforma de hardware funciona como varias plataformas “virtuales”. Intel VT mejora la capacidad de gestión, limitando el tiempo de inactividad y manteniendo la productividad de los trabajadores al aislar las actividades informáticas en particiones independientes.
Intel® 643
Permite que el procesador tenga acceso a mayores cantidades de memoria. Con hardware y software adecuado de 64 bits, las plataformas basadas en un procesador Intel compatible con Intel 64 pueden permitir el uso de memoria física y virtual ampliada.
Bit de desactivación de ejecución4
Proporciona una protección mejorada contra los virus cuando se implanta con un sistema operativo compatible. La memoria se puede marcar como ejecutable o no ejecutable, para que el procesador envíe un mensaje de error al sistema operativo si código malicioso se intenta ejecutar en la memoria no ejecutable. Esto impide las infecciones del sistema por parte de este código.
Solución térmica diseñada por Intel para procesadores en caja
Incluye un conector de 4 patillas para el control de la velocidad del ventilador, con el fin de reducir los niveles de ruido cuando el ventilador funciona a mayor velocidad5. La tecnología de control de la velocidad del ventilador está basada en la temperatura real de la CPU y en el consumo energético.
† Advertencia: si se altera la frecuencia de reloj y/o la tensión, (1) podría reducirse la estabilidad del sistema y la vida útil del sistema y del procesador, (2) el procesador y otros componentes del sistema podrían sufrir daños, (3) podría reducirse el rendimiento del sistema, (4) podrían ocasionarse daños adicionales y (5) podría verse afectada la integridad de los datos del sistema. Intel no ha sometido a prueba, y tampoco garantiza, el funcionamiento del procesador fuera de sus especificaciones.
1 Para el procesador Intel® Core™2 Extreme de Cuatro Núcleos, la caché L2 compartida se refiere a 4 MB de caché L2 por pareja de núcleos, lo que da como resultado un total de 8 MB de caché L2.
2 La tecnología Intel® de Virtualización requiere un sistema informático con un procesador Intel® habilitado, una BIOS, un monitor de máquina virtual (VMM) y, para algunos usos, determinado software de plataforma preparado para esta tecnología. La funcionalidad, el rendimiento u otras ventajas variarán en función de las configuraciones de hardware y de software, y podrán precisar una actualización de la BIOS. Las aplicaciones de software podrán no ser compatibles con todos los sistemas operativos. Solicite detalles a su proveedor de aplicaciones.
3 La informática de 64 bits en la arquitectura Intel requiere un sistema informático con un procesador, un chipset, una BIOS, un sistema operativo, controladores de dispositivo y aplicaciones preparadas para la arquitectura Intel® 64. El procesador no funcionará, ni siquiera en el modo de 32 bits, sin una BIOS preparada para la arquitectura Intel® 64. El rendimiento variará dependiendo de las configuraciones de hardware y de software. Consulte con el proveedor del sistema para obtener más información.
4 Para poder activar la funcionalidad del bit de desactivación de ejecución se necesita un PC con un procesador que la admita y un sistema operativo compatible. Pregunte al fabricante del PC si su sistema ofrece la funcionalidad de bit de desactivación de ejecución.
5 Las ventajas acústicas del cabezal de 4 patillas dependen del correcto diseño de la placa madre. El fabricante de su placa podrá facilitarle más información sobre la compatibilidad.
* Las demás marcas y nombres de productos podrían ser considerados como propiedad de terceros.







HARDWARE - MICROPROCESADORES AMD DE CUATRO NUCLEOS



FOTOS DEL "QUAD CORE"
DE AMD





MICROPROCESADORES “AMD” DE CUATRO NUCLEOS



Los Quad-Core AMD Opteron satisfacen la exigente demanda de los centros de cálculo Bill Laing, director general de la División de Servidores Windows de Microsoft.
AMD ha presentado finalmente el procesador AMD Opteron (conocido anteriormente como Barcelona), el primer microprocesador x86 nativo de cuatro núcleos. Se trata de la apuesta de la compañía para contrarrestar la influencia de Intel Xeon en el mercado de los servidores y entornos de desarrollo. Como novedad, destacar la Arquitectura de Conexión Directa, desarrollada por la propia AMD, que innova en aspectos clave como la eficiencia energética, mayor rendimiento de los procesos de virtualización y la protección de la inversión mediante un enfoque centrado en el cliente que permite una transición fluida desde el núcleo doble al cuádruple con los mismos componentes energéticos y térmicos para ayudar a reducir los costes de infraestructura.En la actualidad, existen más de 50 opciones disponibles de sistema basados en el procesador AMD Opteron de cuatro núcleos procedentes de los principales fabricantes e integradores como Dell, HP, Oracle, Fujitsu, Gateway, Verari o Citrix, entre otros. Bill Laing, director general de la División de Servidores Windows de Microsoft destaca, por ejemplo, que “con la tecnología de núcleos múltiples de 64 bits, la Arquitectura de Conexión Directa y la virtualización integrada, los procesadores AMD Opteron brindan a los usuarios de Microsoft Windows una plataforma innovadora”. En su opinión, si los servidores Windows 2008, SQL 2008 y Visual Studio 2008 se ejecutan sobre procesadores Quad-Core AMD Opteron, supondrán “una plataforma de desarrollo e implementación atractivo para agilizar los dinámicos entornos TI de los clientes”.Los procesadores AMD Opteron de cuatro núcleos con Arquitectura de Conexión Directa se destacan en entornos virtualizados, debido al controlador de memoria integrado –que ofrece una menor latencia de memoria– e Indexado de Virtualización Rápida, una innovación más de AMD en la tecnología de Virtualización AMD diseñada para reducir la sobrecarga asociada a la virtualización de software.La estrategia de núcleo común de AMD permite a los clientes escalar con una arquitectura AMD para reducir la complejidad de gestión de la plataforma e incrementar el tiempo activo y la productividad del centro de datos.


AMD PHENOM X 4


HARDWARE - MICROPROCESADOR INTEL XEON SOCKET 603/604



FOTOS DEL MICROPROCESADOR XEON - SOCKET 603 - 604








NUCLEO INTEL




SOCKET 603




SOCKET 604



" ASI SE DESCRIBEN CADA TIPO DE MICROPROCESADOR XEON"
CANTIDAD DE PINES - BUS - MULTIPLICADOR - VOLTAJE
TIPO DE SOCKET
L1/L2/L3 MEMORIA CACHE
CANTIDAD DE TRANSISTORES




Xeon-1.4G


MMX SSE SSE2(Foster)Mayo 21, 2001 - {$268}
603 pines1400MHz (100x14)(Bus de 64 bits quadpumped)1.7v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)256KB L2 unificada integrada (8-vías)* 4GB cacheable
42 millones0.18µm ancho217mm² área

Xeon-1.5G


MMX SSE SSE2(Foster)Mayo 21, 2001 - {$309}
603 pines1500MHz (100x15)(Bus de 64 bits quadpumped)1.7v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)256KB L2 unificada integrada (8-vías)* 4GB cacheable
42 millones0.18µm ancho217mm² área

Xeon-1.7G


MMX SSE SSE2(Foster)Mayo 21, 2001 - {$406}
603 pines1700MHz (100x17)(Bus de 64 bits quadpumped)1.7v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)256KB L2 unificada integrada (8-vías)* 4GB cacheable
42 millones0.18µm ancho217mm² área

Xeon-2.0G

MMX SSE SSE2(Foster)Septiembre 25, 2001 - {$615}
603 pines2000MHz (100x20)(Bus de 64 bits quadpumped)1.7v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)256KB L2 unificada integrada (8-vías)* 4GB cacheable
42 millones0.18µm ancho217mm² área

LV Xeon-1.6G

MMX SSE SSE2(Prestonia)(Hyperthreading)Septiembre 3, 2002 - {$355}
604 pines1600MHz (100x16)(Bus de 64 bits quadpumped)1.3v
Socket 604
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho146mm² área

Xeon-1.8G


MMX SSE SSE2(Prestonia)(Hyperthreading)Febrero 25, 2002 - {$251}
603 pines1800MHz (100x18)(Bus de 64 bits quadpumped)1.5v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho146mm² área


Xeon-2.0A


MMX SSE SSE2(Prestonia)(Hyperthreading)Febrero 25, 2002 - {$417}
603 pines2000MHz (100x20)(Bus de 64 bits quadpumped)1.5v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho146mm² área


LV Xeon-2.0A


MMX SSE SSE2(Prestonia)(Hyperthreading)Abril, 2003
604 pines2000MHz (100x20)(Bus de 64 bits quadpumped)1.3v
Socket 604
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho146mm² área


Xeon-2.0B


MMX SSE SSE2(Prestonia)(Hyperthreading)Noviembre 18, 2002 - {$198}
604 pines2000MHz (133x15)(Bus de 64 bits quadpumped)1.5v
Socket 604
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho146mm² área


Xeon-2.2G


MMX SSE SSE2(Prestonia)(Hyperthreading)Febrero 25, 2002 - {$615}
603 pines2200MHz (100x22)(Bus de 64 bits quadpumped)1.5v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho146mm² área


Xeon-2.4G


MMX SSE SSE2(Prestonia)(Hyperthreading)Abril 23, 2002 - {$615}
603 pines2400MHz (100x24)(Bus de 64 bits quadpumped)1.5v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho131mm² área

Xeon-2.4G


MMX SSE SSE2(Prestonia)(Hyperthreading)Noviembre 18, 2002 - {$234}
604 pines2400MHz (133x18)(Bus de 64 bits quadpumped)1.5v
Socket 604
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho131mm² área

Xeon-2.6G


MMX SSE SSE2(Prestonia)(Hyperthreading)Septiembre 11, 2002 - {$433}
603 pines2600MHz (100x26)(Bus de 64 bits quadpumped)1.5v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho131mm² área


Xeon-2.67G


MMX SSE SSE2(Prestonia)(Hyperthreading)Noviembre 19, 2002 - {$337}
604 pines2666MHz (133x20)(Bus de 64 bits quadpumped)1.5v
Socket 604
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho131mm² área


Xeon-2.8G


MMX SSE SSE2(Prestonia)(Hyperthreading)Septiembre 11, 2002 - {$562}
603 pines2800MHz (100x28)(Bus de 64 bits quadpumped)1.5v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho131mm² área

Xeon-2.8G


MMX SSE SSE2(Prestonia)(Hyperthreading)Noviembre 18, 2002 - {$455}
604 pines2800MHz (133x21)(Bus de 64 bits quadpumped)1.5v
Socket 604
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho131mm² área


Xeon-3.06G


MMX SSE SSE2(Prestonia)(Hyperthreading)Febrero 3, 2003 - {$722}
604 pines3066MHz (133x23)(Bus de 64 bits quadpumped)1.5v
Socket 604
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)* 64GB cacheable
55 millones0.13µm ancho131mm² área

Xeon-3.06G


MMX SSE SSE2(Gallatin)(Hyperthreading)Julio 14, 2003 - {$690}
604 pines3066MHz (133x23)(Bus de 64 bits quadpumped)1.525v
Socket 604
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)1MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho~230mm² área

Xeon-3.2G


MMX SSE SSE2(Gallatin)(Hyperthreading)Octubre 6, 2003 - {$851}
604 pines3200MHz (133x24)(Bus de 64 bits quadpumped)1.525v
Socket 604
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)1MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho~230mm² área

Xeon 2.8G


MMX SSE SSE2 SSE3(Nocona)(Hyperthreading, EM64T)Julio 28, 2004 - {$209}
604 pines2800MHz (200x14)(Bus de 64 bits quadpumped)1.4v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)* 64GB cacheable
125 millones0.09µm ancho112mm² área

Xeon 3.0G


MMX SSE SSE2 SSE3(Nocona)(Hyperthreading, EM64T)Julio 28, 2004 - {$316}
604 pines3000MHz (200x15)(Bus de 64 bits quadpumped)1.4v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)* 64GB cacheable
125 millones0.09µm ancho112mm² área

Xeon 3.2G


MMX SSE SSE2 SSE3(Nocona)(Hyperthreading, EM64T)Julio 28, 2004 - {$455}
604 pines3200MHz (200x16)(Bus de 64 bits quadpumped)1.4v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)* 64GB cacheable
125 millones0.09µm ancho112mm² área

Xeon 3.4G


MMX SSE SSE2 SSE3(Nocona)(Hyperthreading, EM64T)Julio 28, 2004 - {$690}
604 pines3400MHz (200x17)(Bus de 64 bits quadpumped)1.4v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)* 64GB cacheable
125 millones0.09µm ancho112mm² área


Xeon 3.6G


MMX SSE SSE2 SSE3(Nocona)(Hyperthreading, EM64T)Julio 28, 2004 - {$851}
604 pines3600MHz (200x18)(Bus de 64 bits quadpumped)1.4v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)* 64GB cacheable
125 millones0.09µm ancho112mm² área


Xeon 3.8G


MMX SSE SSE2 SSE3(Nocona)(Hyperthreading, EM64T)[no comercializado]
604 pines3800MHz (200x19)(Bus de 64 bits quadpumped)1.4v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)* 64GB cacheable
125 millones0.09µm ancho112mm² área

Xeon 4.0G


MMX SSE SSE2 SSE3(Nocona)(Hyperthreading, EM64T)[SIN DATOS DE VENTA]
604 pines4000MHz (200x20)(Bus de 64 bits quadpumped)1.4v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)* 64GB cacheable
125 millones0.09µm ancho112mm² área

Xeon 2.8G MMX


SSE SSE2 SSE3(Irwindale)(Hyperthreading, EM64T, NX bit)Febrero 14, 2005
604 pines2800MHz (200x14)(Bus de 64 bits quadpumped)?v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)2MB L2 unificada integrada (8-vías)* 64GB cacheable
133 millones0.09µm ancho?mm² área


Xeon LV 3.0G


MMX SSE SSE2 SSE3(Irwindale)(Hyperthreading, EM64T, NX bit)Septiembre 26, 2005 - {$519}
604 pines3000MHz (200x15)(Bus de 64 bits quadpumped)?v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)2MB L2 unificada integrada (8-vías)* 64GB cacheable
133 millones0.09µm ancho?mm² área

Xeon 3.0G


MMX SSE SSE2 SSE3(Irwindale)(Hyperthreading, EM64T, NX bit)Febrero 14, 2005 - {$316}
604 pines3000MHz (200x15)(Bus de 64 bits quadpumped)?v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)2MB L2 unificada integrada (8-vías)* 64GB cacheable
133 millones0.09µm ancho?mm² área

Xeon MV 3.2G


MMX SSE SSE2 SSE3(Irwindale)(Hyperthreading, EM64T, NX bit)Septiembre 26, 2005 - {$487}
604 pines3200MHz (200x16)(Bus de 64 bits quadpumped)?v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)2MB L2 unificada integrada (8-vías)* 64GB cacheable
133 millones0.09µm ancho?mm² área

Xeon 3.2G


MMX SSE SSE2 SSE3(Irwindale)(Hyperthreading, EM64T, NX bit)Febrero 14, 2005 - {$455}
604 pines3200MHz (200x16)(Bus de 64 bits quadpumped)?v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)2MB L2 unificada integrada (8-vías)* 64GB cacheable
133 millones0.09µm ancho?mm² área

Xeon 3.4G


MMX SSE SSE2 SSE3(Irwindale)(Hyperthreading, EM64T, NX bit)Febrero 14, 2005 - {$690}
604 pines3400MHz (200x17)(Bus de 64 bits quadpumped)?v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)2MB L2 unificada integrada (8-vías)* 64GB cacheable
133 millones0.09µm ancho?mm² área

Xeon 3.6G


MMX SSE SSE2 SSE3(Irwindale)(Hyperthreading, EM64T, NX bit)Febrero 14, 2005 - {$851}
604 pines3600MHz (200x18)(Bus de 64 bits quadpumped)?v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)2MB L2 unificada integrada (8-vías)* 64GB cacheable
133 millones0.09µm ancho?mm² área

Xeon 3.8G


MMX SSE SSE2 SSE3(Irwindale)(Hyperthreading, EM64T, NX bit)Septiembre 26, 2005 - {$851}
604 pines3800MHz (200x19)(Bus de 64 bits quadpumped)?v
Socket 604
16KB datos (8-vías)12k µoperaciones (8-vías)2MB L2 unificada integrada (8-vías)* 64GB cacheable
133 millones0.09µm ancho?mm² área

Xeon DP-2.8G


MMX SSE SSE2 SSE3(Paxville DP)(dual coe, Hyperthreading, EM64T, NX bit)Octubre 10, 2005 - {$1043}
604 pines2800MHz (200x14)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
230 millones0.09µm ancho206mm² área

Xeon DP-


MMX SSE SSE2 SSE3(Paxville DP)(dual coe, Hyperthreading, EM64T, NX bit)DIC. 2006
604 pines-MHz (166x?)(Bus de 64 bits quadpumped)v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
230 millones0.09µm ancho206mm² área

Xeon MP-1.4G


MMX SSE SSE2(Foster MP)(Hyperthreading)Marzo 12, 2002 - {$1177}
603 pines1400MHz (100x14)(Bus de 64 bits quadpumped)1.7v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)256KB L2 unificada integrada (8-vías)512KB L3 (?-vías)* 64GB cacheable
108 millones0.18µm ancho?mm² área

Xeon MP-1.5G


MMX SSE SSE2(Foster MP)(Hyperthreading)Marzo 12, 2002 - {$1980}
603 pines1500MHz (100x15)(Bus de 64 bits quadpumped)1.7v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)256KB L2 unificada integrada (8-vías)512KB L3 (?-vías)* 64GB cacheable
108 millones0.18µm ancho?mm² área

Xeon MP-1.6G


MMX SSE SSE2(Foster MP)(Hyperthreading)Marzo 12, 2002 - {$3692}
603 pines1600MHz (100x16)(Bus de 64 bits quadpumped)1.7v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)256KB L2 unificada integrada (8-vías)1MB L3 (?-vías)* 64GB cacheable
108 millones0.18µm ancho?mm² área

Xeon MP-1.7G


MMX SSE SSE2(Foster MP)(Hyperthreading)[no comercializado]
603 pines1700MHz (100x17)(Bus de 64 bits quadpumped)1.7v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)256KB L2 unificada integrada (8-vías)1MB L3 (?-vías)* 64GB cacheable
108 millones0.18µm ancho?mm² área

Xeon MP-1.5G


MMX SSE SSE2(Gallatin)(Hyperthreading)Noviembre 4, 2002 - {$1177}
603 pines1500MHz (100x15)(Bus de 64 bits quadpumped)1.475v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)1MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho~230mm² área

Xeon MP-1.9G


MMX SSE SSE2(Gallatin)(Hyperthreading)Noviembre 4, 2002 - {$1980}
603 pines1900MHz (100x19)(Bus de 64 bits quadpumped)1.475v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)1MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho~230mm² área

Xeon MP-2.0G


MMX SSE SSE2(Gallatin)(Hyperthreading)Junio 30, 2003 - {$1177}
603 pines2000MHz (100x20)(Bus de 64 bits quadpumped)1.475v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)1MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho~230mm² área

Xeon MP-2.0G


MMX SSE SSE2(Gallatin)(Hyperthreading)Noviembre 4, 2002 - {$3692}
603 pines2000MHz (100x20)(Bus de 64 bits quadpumped)1.475v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)2MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho~230mm² área

Xeon MP-2.2G


MMX SSE SSE2(Gallatin)(Hyperthreading)Marzo 2, 2004 - {$1177}
603 pines2200MHz (100x22)(Bus de 64 bits quadpumped)1.475v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)2MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho?mm² área

Xeon MP-2.5G


MMX SSE SSE2(Gallatin)(Hyperthreading)Junio 30, 2003 - {$1980}
603 pines2500MHz (100x25)(Bus de 64 bits quadpumped)1.475v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)1MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho~230mm² área

Xeon MP-2.7G


MMX SSE SSE2(Gallatin)(Hyperthreading)Marzo 2, 2004 - {$1980}
603 pines2700MHz (100x27)(Bus de 64 bits quadpumped)1.475v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)2MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho?mm² área

Xeon MP-2.8G


MMX SSE SSE2(Gallatin)(Hyperthreading)Junio 30, 2003 - {$3692}
603 pines2800MHz (100x28)(Bus de 64 bits quadpumped)1.475v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)2MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho~230mm² área

Xeon MP-3.0G


MMX SSE SSE2(Gallatin)(Hyperthreading)Marzo 2, 2004 - {$3692}
603 pines3000MHz (100x30)(Bus de 64 bits quadpumped)1.5v
Socket 603
8KB datos (4-vías)12k µoperaciones (8-vías)512KB L2 unificada integrada (8-vías)4MB L3 integrada (8-vías)* 64GB cacheable
169 millones0.13µm ancho?mm² área

Xeon MP 3.16G


MMX SSE SSE2 SSE3(Cranfod)(Hyperthreading, EM64T, NX bit)Marzo 29, 2005 - {$722}
604 pines3166MHz (166x19)(Bus de 64 bits quadpumped)1.4v
Socket 604
16KB datos (?-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon MP 3.66G


MMX SSE SSE2 SSE3(Cranfod)(Hyperthreading, EM64T, NX bit)Marzo 29, 2005 - {$963}
604 pines3666MHz (166x22)(Bus de 64 bits quadpumped)1.4v
Socket 604
16KB datos (?-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon MP 2.83G


MMX SSE SSE2 SSE3(Potomac)(Hyperthreading, EM64T, NX bit)Marzo 29, 2005 - {$1177}
604 pines2833MHz (166x17)(Bus de 64 bits quadpumped)1.3875v
Socket 604
16KB datos (?-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)4MB L3 integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon MP 3.0G


MMX SSE SSE2 SSE3(Potomac)(Hyperthreading, EM64T, NX bit)Marzo 29, 2005 - {$1980}
604 pines3000MHz (166x18)(Bus de 64 bits quadpumped)1.3875v
Socket 604
16KB datos (?-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)8MB L3 integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon MP 3.33G


MMX SSE SSE2 SSE3(Potomac)(Hyperthreading, EM64T, NX bit)Marzo 29, 2005 - {$3692}
604 pines3333MHz (166x20)(Bus de 64 bits quadpumped)1.3875v
Socket 604
16KB datos (?-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)8MB L3 integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon MP 3.5G


MMX SSE SSE2 SSE3(Potomac)(Hyperthreading, EM64T, NX bit)2006?
604 pines3500MHz (166x21)(Bus de 64 bits quadpumped)1.3875v
Socket 604
16KB datos (?-vías)12k µoperaciones (8-vías)1MB L2 unificada integrada (8-vías)8MB L3 integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon 7020


MMX SSE SSE2 SSE3(Paxville MP)(dual core, Hyperthreading, EM64T, NX bit)Noviembre 1, 2006 - {$1177}
604 pines2666MHz (166x16)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon 7030


MMX SSE SSE2 SSE3(Paxville MP)(dual core, Hyperthreading, EM64T, NX bit)Noviembre 1, 2006 - {$1980}
604 pines2800MHz (200x14)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon 7040


MMX SSE SSE2 SSE3(Paxville MP)(dual core, Hyperthreading, EM64T, NX bit)Noviembre 1, 2006 - {$3157}
604 pines3000MHz (166x18)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon 7041


MMX SSE SSE2 SSE3(Paxville MP)(dual core, Hyperthreading, EM64T, NX bit)Noviembre 1, 2006 - {$3157}
604 pines3000MHz (200x15)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon serie 7000


MMX SSE SSE2 SSE3(Paxville MP)(dual core, Hyperthreading, EM64T, NX bit)Dec 2006?
604 pines?MHz (200x?)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)* ?GB cacheable
? millones0.09µm ancho?mm² área

Xeon 7110N


MMX SSE SSE2 SSE3(Tulsa)(dual core, Hyperthreading, EM64T, NX bit)Agosto 29, 2006 - {$856}
604 pines2500MHz (166x15)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)4MB on-Área shared L3 (16-vías)* ?GB cacheable
1600+ millones0.065µm ancho435mm² área

Xeon 7110M


MMX SSE SSE2 SSE3(Tulsa)(dual core, Hyperthreading, EM64T, NX bit)Agosto 29, 2006 - {$856}
604 pines2600MHz (200x13)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)4MB on-Área shared L3 (16-vías)* ?GB cacheable
1600+ millones0.065µm ancho435mm² área

Xeon 7120N


MMX SSE SSE2 SSE3(Tulsa)(dual core, Hyperthreading, EM64T, NX bit)Agosto 29, 2006 - {$1177}
604 pines3000MHz (166x18)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)4MB on-Área shared L3 (16-vías)* ?GB cacheable
1600+ millones0.065µm ancho435mm² área

Xeon 7120M


MMX SSE SSE2 SSE3(Tulsa)(dual core, Hyperthreading, EM64T, NX bit)Agosto 29, 2006 - {$1177}
604 pines3000MHz (200x15)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)4MB on-Área shared L3 (16-vías)* ?GB cacheable
1600+ millones0.065µm ancho435mm² área

Xeon 7130N


MMX SSE SSE2 SSE3(Tulsa)(dual core, Hyperthreading, EM64T, NX bit)Agosto 29, 2006 - {$1391}
604 pines3166MHz (166x19)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)8MB on-Área shared L3 (16-vías)* ?GB cacheable
1600+ millones0.065µm ancho435mm² área

Xeon 7130M


MMX SSE SSE2 SSE3(Tulsa)(dual core, Hyperthreading, EM64T, NX bit)Agosto 29, 2006 - {$1391}
604 pines3200MHz (200x16)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)8MB on-Área shared L3 (16-vías)* ?GB cacheable
1600+ millones0.065µm ancho435mm² área

Xeon 7140N


MMX SSE SSE2 SSE3(Tulsa)(dual core, Hyperthreading, EM64T, NX bit)Agosto 29, 2006 - {$1980}
604 pines3333MHz (166x20)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)16MB on-Área shared L3 (16-vías)* ?GB cacheable
1600+ millones0.065µm ancho435mm² área

Xeon 7140M


MMX SSE SSE2 SSE3(Tulsa)(dual core, Hyperthreading, EM64T, NX bit)Agosto 29, 2006 - {$1980}
604 pines3400MHz (200x17)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)16MB on-Área shared L3 (16-vías)* ?GB cacheable
1600+ millones0.065µm ancho435mm² área

Xeon SOSSAMAN


MMX SSE SSE2 SSE3(Sossaman)(dual core, Hyperthreading, EM64T, NX bit)2006
604 pines?MHz (166x?)(Bus de 64 bits quadpumped)?v
Socket 604
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x ?MB L2 unificada integrada (8-vías)* ?GB cacheable
? millones0.065µm ancho?mm² área




HARDWARE - MICROPROCESADOR INTEL ITANIUM 2

FOTOS DEL MICROPROCESADOR INTEL ITANIUM 2



FOTO MICROPROCESADOR INTEL ITANIUM 2

MOTHER PARA MICROPROCESADOR INTEL ITANIUM 2




SOCKET PAC 418



FOTO SOCKET PAC 611



MicroProcesador Intel Itanium 2
Placa Mother para MicroProcesador Intel Itanium 2
Intel Itanium/Itanium 2
Núcleo Intel
Nº de pines, bus, multiplicado y voltaje
Socket
L1/L2/L3 Cache
Transistores
Itanium-733 MMX SSE(Merced)Julio, 2001
418 pines733MHz (133x5.5)(Bus de 64 bits dualpumped)?v
PAC418
16KB datos (4-vías)16KB instrucciones (4-vías)96KB L2 unificada integrada (6-vías)2MB o4MB unificada L3 (4-vías)* 16TB cacheable
25 millones0.18µm ancho~300mm² área? millones L3 {?µm - ?mm²} (2MB)295 millones L3 {?µm - ?mm²} (4MB)
Itanium-800 MMX SSE(Merced)Julio, 2001
418 pines800MHz (133x6.0)(Bus de 64 bits dualpumped)?v
PAC418
16KB datos (4-vías)16KB instrucciones (4-vías)96KB L2 unificada integrada (6-vías)2MB o4MB unificada L3 (4-vías)* 16TB cacheable
25 millones0.18µm ancho~300mm² área? millones L3 {?µm - ?mm²} (2MB)295 millones L3 {?µm - ?mm²} (4MB)

Itanium 2-900 MMX SSE(McKinley)Julio 8, 2002 - {$1338} (1.5MB)
611 pines900MHz (200x4.5)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada1.5MB on-Área unificada L3* ?GB cacheable
221 millones0.18µm ancho463mm² área
Itanium 2-1.0G MMX SSE(McKinley)Julio 8, 2002 - {$?} (1.5MB)Julio 8, 2002 - {$4226} (3MB)
611 pines1000MHz (200x5.0)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada1.5MB o3MB on-Área unificada L3* ?GB cacheable
221 millones0.18µm ancho463mm² área

Itanium 2-1.3G MMX SSE(Madison) - copper chipJunio 30, 2003 - {$1338}
611 pines1300MHz (200x6.5)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada3MB on-Área unificada L3* ?GB cacheable
~500 millones0.13µm ancho?mm² área
Itanium 2-1.4G MMX SSE(Madison) - copper chipJunio 30, 2003 - {$2247}
611 pines1400MHz (200x7.0)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada4MB on-Área unificada L3* ?GB cacheable
~500 millones0.13µm ancho?mm² área
Itanium 2-1.5G MMX SSE(Madison) - copper chipJunio 30, 2003 - {$3692} (6MB)Noviembre, 2004 (4MB)
611 pines1500MHz (200x7.5)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada4MB o6MB on-Área unificada L3* ?GB cacheable
~500 millones0.13µm ancho?mm² área

Itanium 2-1.6G MMX SSE(Madison 9M)Noviembre, 2004
611 pines1600MHz (200x8.0)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada6MB o9MB on-Área unificada L3* ?GB cacheable
? millones?µm ancho?mm² área
Itanium 2-1.66G MMX SSE(Madison 9M)Julio, 2005
611 pines1666MHz (333x5.0)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada6MB o9MB on-Área unificada L3* ?GB cacheable
? millones?µm ancho?mm² área

LV Itanium 2-1.0G MMX SSE(Deerfield)Septiembre 8, 2003 - {$744}
611 pines1000MHz (200x5.0)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada1.5MB on-Área unificada L3* ?GB cacheable
? millones0.13µm ancho?mm² área
LV Itanium 2-1.3G MMX SSE(Deerfield)Noviembre, 2004
611 pines1300MHz (200x6.5)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada3MB on-Área unificada L3* ?GB cacheable
? millones0.13µm ancho?mm² área
Itanium 2-1.4G MMX SSE(Deerfield)Septiembre 8, 2003 - {$1172} (1.5MB)Abril 13, 2004 - {$1172} (3MB)
611 pines1400MHz (200x7.0)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada1.5MB o3MB on-Área unificada L3* ?GB cacheable
? millones0.13µm ancho?mm² área
Itanium 2-1.6G MMX SSE(Deerfield)Mayo, 2004 - {$2408}
611 pines1600MHz (200x8.0)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada3MB on-Área unificada L3* ?GB cacheable
? millones0.13µm ancho?mm² área
Itanium 2-1.6G MMX SSE(Deerfield)Noviembre, 2004 - {$2408}
611 pines1600MHz (266x6.0)(128-bit dual-pumped bus)?v
PAC611
16KB datos16KB instrucciones256KB L2 unificada integrada3MB on-Área unificada L3* ?GB cacheable
? millones0.13µm ancho?mm² área

Itanium 2-9010 MMX SSE(Montecito)(Hyperthreading)2006?
611 pines1600MHz (200x8.0)(128-bit dual-pumped bus)?v
PAC611
?KB datos?KB instrucciones1MB L2 unificada integrada6MB on-Área unificada L3* ?GB cacheable
1720 millones0.09µm ancho?mm² área
Itanium 2-9020 MMX SSE(Montecito)(dual coe, Hyperthreading)2006?
611 pines1400MHz (200x7.0)(128-bit dual-pumped bus)?v
PAC611
2x ?KB datos2x ?KB instrucciones2x 1MB L2 unificada integrada2x 9MB on-Área unificada L3* ?GB cacheable
1720 millones0.09µm ancho?mm² área
Itanium 2-9040 MMX SSE(Montecito)(dual coe, Hyperthreading)2006?
611 pines1600MHz (266x6.0)(128-bit dual-pumped bus)?v
PAC611
2x ?KB datos2x ?KB instrucciones2x 1MB L2 unificada integrada2x 9MB on-Área unificada L3* ?GB cacheable
1720 millones0.09µm ancho?mm² área
Itanium 2-??? MMX SSE(Montecito)(dual coe, Hyperthreading)2006?
611 pines?MHz (?x?)(128-bit dual-pumped bus)?v
PAC611
2x ?KB datos2x ?KB instrucciones2x 1MB L2 unificada integrada2x 12MB on-Área unificada L3* ?GB cacheable
1720 millones0.09µm ancho?mm² área

Itanium 2-??? MMX SSE(Fanwood - 2-vías)(dual coe, Hyperthreading)2006?
? pines?MHz (?x?)(128-bit dual-pumped bus)?v
?
2x ?KB datos2x ?KB instrucciones2x ?MB L2 unificada integrada2x ?MB on-Área unificada L3* ?GB cacheable
? millones?µm ancho?mm² área

Itanium 2-??? MMX SSE(Millington - 2-vías)(dual coe, Hyperthreading)2006?
? pines?MHz (?x?)(128-bit dual-pumped bus)?v
?
2x ?KB datos2x ?KB instrucciones2x ?MB L2 unificada integrada2x ?MB on-Área unificada L3* ?GB cacheable
? millones?µm ancho?mm² área

Itanium 2-??? MMX SSE(Shavano)(Hyperthreading)2006?
? pines?MHz (?x?)(128-bit dual-pumped bus)?v
?
?KB datos?KB instrucciones?MB L2 unificada integrada?MB on-Área unificada L3* ?GB cacheable
? millones?µm ancho?mm² área

Itanium 2-??? MMX SSE(Montvale)(dual coe, Hyperthreading)2006?
? pines?MHz (?x?)(128-bit dual-pumped bus)?v
?
2x ?KB datos2x ?KB instrucciones2x 1MB L2 unificada integrada2x 12MB on-Área unificada L3* ?GB cacheable
? millones0.065µm ancho?mm² área

Itanium 3-??? MMX SSE(Tukwila)(multi coe, Hyperthreading)2006?
? pines?MHz (?x?)(?-bit ?-pumped bus)?v
?
4x ?KB datos4x ?KB instrucciones4x ?MB L2 unificada integrada4x ?MB on-Área unificada L3* ?GB cacheable
? millones0.065µm ancho?mm² área

Itanium 3-??? MMX SSE(Dimona)(dual coe, Hyperthreading)2006?
? pines?MHz (?x?)(?-bit ?-pumped bus)?v
?
2x ?KB datos2x ?KB instrucciones2x ?MB L2 unificada integrada2x ?MB on-Área unificada L3* ?GB cacheable
? millones?µm ancho?mm² área

Itanium 3-??? MMX SSE(Poulson)(multi coe, Hyperthreading)2006?
? pines?MHz (?x?)(?-bit ?-pumped bus)?v
?
4x ?KB datos4x ?KB instrucciones4x ?MB L2 unificada integrada
? millones?µm ancho?mm² área



TUTORIALES HARDWARE - MICROPROCESADORES INTEL XEON DUAL CORE



FOTOS DEL MICROPROCESADOR INTEL XEON DUAL CORE
PARA SOCKET 771




INTEL PENTIUM XEON 3200

CON BUS DE 800 MHZ


FOTO-SOCKET-771-LGA




Xeon (Socket 771)
Núcleo Intel
Nº de pines, bus, multiplicado y voltaje
Socket
L1/L2/L3 Cache
Transistores
Xeon 5030 MMX SSE SSE2 SSE3(Dempsey)(dual área, Hyperthreading, EM64T, NX bit, VT)Mayo 23, 2006
771 bolas2666MHz (166x16)(Bus de 64 bits quadpumped)?v
Socket 771
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
230 millones0.065µm ancho206mm² área
Xeon 5050 MMX SSE SSE2 SSE3(Dempsey)(dual área, Hyperthreading, EM64T, NX bit, VT)Mayo 23, 2006
771 bolas3000MHz (166x18)(Bus de 64 bits quadpumped)?v
Socket 771
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
230 millones0.065µm ancho206mm² área
Xeon 5060 MMX SSE SSE2 SSE3(Dempsey)(dual área, Hyperthreading, EM64T, NX bit, VT)Mayo 23, 2006
771 bolas3200MHz (266x12)(Bus de 64 bits quadpumped)?v
Socket 771
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
230 millones0.065µm ancho206mm² área
Xeon 5063 MMX SSE SSE2 SSE3(Dempsey)(dual área, Hyperthreading, EM64T, NX bit, VT)Mayo 23, 2006
771 bolas3200MHz (266x12)(Bus de 64 bits quadpumped)?v
Socket 771
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
230 millones0.065µm ancho206mm² área
Xeon 5080 MMX SSE SSE2 SSE3(Dempsey)(dual área, Hyperthreading, EM64T, NX bit, VT)Mayo 23, 2006
771 bolas3733MHz (266x14)(Bus de 64 bits quadpumped)?v
Socket 771
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
230 millones0.065µm ancho206mm² área
Núcleo Intel
Nº de pines, bus, multiplicado y voltaje
Socket
L1/L2/L3 Cache
Transistores
Xeon 5110 MMX SSE SSE2 SSE3(Woodcrest)(dual coe, EM64T)Junio 26, 2006
771 bolas1600MHz (266x6)(Bus de 64 bits quadpumped)?v
Socket 771
2x 32KB datos (8-vías)2x 32KB instrucciones (8-vías)4MB on-Área shared L2 (16-vías)* 64GB cacheable
? millones0.065µm ancho?mm² área
Xeon 5120 MMX SSE SSE2 SSE3(Woodcrest)(dual coe, EM64T)Junio 26, 2006
771 bolas1866MHz (266x7)(Bus de 64 bits quadpumped)?v
Socket 771
2x 32KB datos (8-vías)2x 32KB instrucciones (8-vías)4MB on-Área shared L2 (16-vías)* 64GB cacheable
? millones0.065µm ancho?mm² área
Xeon 5130 MMX SSE SSE2 SSE3(Woodcrest)(dual coe, EM64T)Junio 26, 2006
771 bolas2000MHz (333x6)(Bus de 64 bits quadpumped)?v
Socket 771
2x 32KB datos (8-vías)2x 32KB instrucciones (8-vías)4MB on-Área shared L2 (16-vías)* 64GB cacheable
? millones0.065µm ancho?mm² área
Xeon 5140 MMX SSE SSE2 SSE3(Woodcrest)(dual coe, EM64T)Junio 26, 2006
771 bolas2333MHz (333x7)(Bus de 64 bits quadpumped)?v
Socket 771
2x 32KB datos (8-vías)2x 32KB instrucciones (8-vías)4MB on-Área shared L2 (16-vías)* 64GB cacheable
? millones0.065µm ancho?mm² área
Xeon LV 5148 MMX SSE SSE2 SSE3(Woodcrest)(dual coe, EM64T)Junio 26, 2006
771 bolas2333MHz (333x7)(Bus de 64 bits quadpumped)?v
Socket 771
2x 32KB datos (8-vías)2x 32KB instrucciones (8-vías)4MB on-Área shared L2 (16-vías)* 64GB cacheable
? millones0.065µm ancho?mm² área
Xeon 5150 MMX SSE SSE2 SSE3(Woodcrest)(dual coe, EM64T)Junio 26, 2006
771 bolas2666MHz (333x8)(Bus de 64 bits quadpumped)?v
Socket 771
2x 32KB datos (8-vías)2x 32KB instrucciones (8-vías)4MB on-Área shared L2 (16-vías)* 64GB cacheable
? millones0.065µm ancho?mm² área
Xeon 5160 MMX SSE SSE2 SSE3(Woodcrest)(dual coe, EM64T)Junio 26, 2006
771 bolas3000MHz (333x9)(Bus de 64 bits quadpumped)?v
Socket 771
2x 32KB datos (8-vías)2x 32KB instrucciones (8-vías)4MB on-Área shared L2 (16-vías)* 64GB cacheable
? millones0.065µm ancho?mm² área
Xeon MMX SSE SSE2 SSE3(Woodcrest)(dual coe, EM64T)2006?
771 bolas?MHz (333x?)(Bus de 64 bits quadpumped)?v
Socket 771
2x 32KB datos (8-vías)2x 32KB instrucciones (8-vías)4MB on-Área shared L2 (16-vías)* 64GB cacheable
? millones0.065µm ancho?mm² área

??? MMX SSE SSE2 SSE3(Tigerton)(cuádruple core, EM64T)2007?
771 bolas?MHz (?x?)(Bus de 64 bits quadpumped)?v
Socket 771
2x 32KB datos (8-vías)2x 32KB instrucciones (8-vías)2x ?MB L2 unificada integrada (?-vías)* 64GB cacheable
? millones?µm ancho?mm² área

??? MMX SSE SSE2 SSE3(Clovertown)(cuádruple core, dual área, EM64T)2007?
771 bolas?MHz (?x?)(Bus de 64 bits quadpumped)?v
Socket 771
4x 32KB datos (8-vías)4x 32KB instrucciones (8-vías)2x 4MB on-Área shared L2 (16-vías)* 64GB cacheable
? millones?µm ancho?mm² área

??? MMX SSE SSE2 SSE3(Whitefield)(multi coe, EM64T)2008?
771 bolas?MHz (?x?)(Bus de 64 bits quadpumped)?v
Socket 771
?x 32KB datos (8-vías)?x 32KB instrucciones (8-vías)?MB on-Área shared L2 (?-vías)* 64GB cacheable
? millones0.065µm ancho?mm² área

??? MMX SSE SSE2 SSE3(Dunnington)(multi coe, EM64T)2008?
771 bolas?MHz (?x?)(Bus de 64 bits quadpumped)?v
Socket 771
?x 32KB datos (8-vías)?x 32KB instrucciones (8-vías)?MB on-Área shared L2 (?-vías)* 64GB cacheable
? millones?µm ancho?mm² área

??? MMX SSE SSE2 SSE3(Hapertown)(8 coe, quad área, EM64T)2008?
771 bolas?MHz (?x?)(Bus de 64 bits quadpumped)?v
Socket 771
8x 32KB datos (8-vías)8x 32KB instrucciones (8-vías)?MB on-Área shared L2 (?-vías)* 64GB cacheable
? millones0.045µm ancho?mm² área




TUTORIALES HARDWARE - MICROPROCESADORES PENTIUM D



FOTOS DEL MICROPROCESADOR INTEL PENTIUM D


( SOCKET 775 ) – FICHA TECNICA








Intel Pentium D (Socket 775)
El Procesador Intel Pentium D es un procesador de doble núcleo para PCs de sobremesa. Dispone de dos núcleos independientes para ejecutar los comandos en un único procesador físico.Ambos núcleos funcionan con la misma frecuencia.Ambos procesadores se encuentran dentro de la misma estructura y están conectados al chipset y a la memoria a través de la misma interfaz.
Multitarea a toda velocidadGracias a un PC basado en el Procesador Intel Pentium D con dos núcleos de procesamiento completo, obtendrá la flexibilidad y el rendimiento necesarios para gestionar el entretenimiento multimedia, la edición de fotografía digital y varios usuarios por igual simultáneamente. Su PC recibe recursos para la multitarea, de forma que podrá conseguir más al tiempo que ejecuta varias aplicaciones, como edición de vídeo y descarga de música.
Creado para aplicaciones avanzadasObtenga el máximo partido posible de sus exigentes aplicaciones de subprocesos múltiples, perfectas para un nuevo mundo de entretenimiento de alta gama. El PC basado en el Procesador Intel Pentium D con tecnología de procesamiento Intel de doble núcleo ofrece el rendimiento necesario para beneficiarse de los sofisticados programas de juegos, lo que se traduce en realistas entornos de juegos y desafiante capacidad para jugar.
Multiplique su experiencia multimediaEn combinación con un adaptador multimedia digital y una red doméstica, un PC basado en el procesador Intel Pentium D permite que dos personas compartan contenido de PC en la misma habitación o incluso desde diferentes lugares de la casa. Por ejemplo, una persona puede consultar el correo electrónico mientras que otra utiliza un mando a distancia para acceder a fotografías digitales almacenadas en el mismo PC y verlas en la TV del salón
Intel Pentium D (Socket 775)
Núcleo Intel
Nº de pines, bus, multiplicado y voltaje
Socket
Caché L1/L2x
Transistores
Pentium D-805 MMX SSE SSE2 SSE3(Smithfield)(dual coe, EM64T, NX bit)Febrero, 2006
775 bolas2666MHz (133x20)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)* 4GB cacheable
230 millones0.09µm ancho206mm² área
Pentium D-820 MMX SSE SSE2 SSE3(Smithfield)(dual coe, EM64T, NX bit)Mayo 26, 2005 - {$241}
775 bolas2800MHz (200x14)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)* 4GB cacheable
230 millones0.09µm ancho206mm² área
Pentium D-830 MMX SSE SSE2 SSE3(Smithfield)(dual coe, EM64T, NX bit)Mayo 26, 2005 - {$316}
775 bolas3000MHz (200x15)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)* 4GB cacheable
230 millones0.09µm ancho206mm² área
Pentium D-840 MMX SSE SSE2 SSE3(Smithfield)(dual coe, EM64T, NX bit)Mayo 26, 2005 - {$530}
775 bolas3200MHz (200x16)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)* 4GB cacheable
230 millones0.09µm ancho206mm² área

Pentium D-915 MMX SSE SSE2 SSE3(Presler)(dual área, EM64T, NX bit)2H 2006
775 bolas2800MHz (200x14)(Bus de 64 bits quadpumped)1.3v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área
Pentium D-920 MMX SSE SSE2 SSE3(Presler)(dual área, EM64T, NX bit, VT)Febrero, 2006 - {$241}
775 bolas2800MHz (200x14)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área
Pentium D-925 MMX SSE SSE2 SSE3(Presler)(dual área, EM64T, NX bit)[no comercializado]
775 bolas3000MHz (200x15)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área
Pentium D-930 MMX SSE SSE2 SSE3(Presler)(dual área, EM64T, NX bit, VT)Febrero, 2006 - {$316}
775 bolas3000MHz (200x15)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área
Pentium D-940 MMX SSE SSE2 SSE3(Presler)(dual área, EM64T, NX bit, VT)Febrero, 2006 - {$423}
775 bolas3200MHz (200x16)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área
Pentium D-945 MMX SSE SSE2 SSE3(Presler)(dual área, EM64T, NX bit)2H 2006
775 bolas3400MHz (200x17)(Bus de 64 bits quadpumped)?v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área
Pentium D-950 MMX SSE SSE2 SSE3(Presler)(dual área, EM64T, NX bit, VT)Febrero, 2006 - {$637}
775 bolas3400MHz (200x17)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área
Pentium D-960 MMX SSE SSE2 SSE3(Presler)(dual área, EM64T, NX bit, VT)2H 2006
775 bolas3600MHz (200x18)(Bus de 64 bits quadpumped)1.3v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área

Pentium Extreme-840 MMX SSE SSE2 SSE3(Smithfield)(dual coe, Hyperthreading, EM64T, NX bit)Abril 18, 2005 - {$999}
775 bolas3200MHz (200x16)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones (8-vías)2x 1MB L2 unificada integrada (8-vías)* ?GB cacheable
230 millones0.09µm ancho206mm² área

Pentium Extreme-955 MMX SSE SSE2 SSE3(Presler)(dual área, Hyperthreading, EM64T, NX bit, VT)Enero, 2006 - {$999}
775 bolas3466MHz (266x13)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área

775 bolas3733MHz (266x14)(Bus de 64 bits quadpumped)1.4v
Socket T
2x 16KB datos (8-vías)2x 12k µoperaciones instrucciones (8-vías)2x 2MB L2 unificada integrada (8-vías)* ?GB cacheable
376 millones0.065µm ancho140mm² área




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